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MCU产品级项目收集

介绍

该仓库主要上传平时从Github/码云收集的一些大佬们上传的产品级项目,可能是基于STM32的,也可能是基于其它芯片方案的等等,如有违规,请联系我删除

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网友提问

可以移植到cyclone Ⅳ的板子上吗? CoreMark测试环境 问题:Written PC (0x0) does not match read back value (0xa5a5a5a5) gen_ram.v 中 generate if 块 bram分支移植应该可以完全按照master的步骤,但下载c语言成功后,无法实现功能 remote_bitbang中需要把一些变量定义从.h移动到.c 针对verilator分支jtag_dtm下,dtmcs_abits位宽的问题 请问对于那么多密集的指令,我改如何去理解? error while loading shared libraries: libhidapi-hidraw.so.0: cannot open shared test_all_isa.py 代码 没有意义 spartan-6的板子资源够吗,能不能移植呢 代码错误 为什么不用memroy资源来例化rom和ram,用LC资源来做rom和ram对FPGA的LC资源要求太大了。 riscv tinyriscv.v 顶层模块有错误 请问Debug模块可以支持GDB单步调试吗?还是只能下载程序? risc-v B类型指令立即数最高位有什么特殊的含义吗 full_handshake_tx.v, full_handshake_rx.v有语法错误 Linux下交叉编译工具链更新 在linux环境下运行新的指令测试程序出错了 可以移植到cyclone Ⅳ的板子上吗? CoreMark测试环境 问题:Written PC (0x0) does not match read back value (0xa5a5a5a5) gen_ram.v 中 generate if 块 bram分支移植应该可以完全按照master的步骤,但下载c语言成功后,无法实现功能 remote_bitbang中需要把一些变量定义从.h移动到.c 针对verilator分支jtag_dtm下,dtmcs_abits位宽的问题 请问对于那么多密集的指令,我改如何去理解? error while loading shared libraries: libhidapi-hidraw.so.0: cannot open shared test_all_isa.py 代码 没有意义 spartan-6的板子资源够吗,能不能移植呢 代码错误 为什么不用memroy资源来例化rom和ram,用LC资源来做rom和ram对FPGA的LC资源要求太大了。 riscv tinyriscv.v 顶层模块有错误 请问Debug模块可以支持GDB单步调试吗?还是只能下载程序? risc-v B类型指令立即数最高位有什么特殊的含义吗 full_handshake_tx.v, full_handshake_rx.v有语法错误 Linux下交叉编译工具链更新 在linux环境下运行新的指令测试程序出错了 点此下载当前源码

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